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信息技术二类专业集成触发器测试卷

2023-10-21 理论教育 版权反馈
【摘要】：( )3.JK触发器只要J,K端同时为1,则一定引起状态翻转。第1题图2.试用D触发器和门电路构成T触发器,画出电路图。

一、单项选择题

1.关于时序逻辑电路,下列说法不正确的是( )

A.具有记忆功能

B.输出不仅与输入有关,还与电路之前的状态有关

C.由触发器和门电路构成

D.常见类型有编码器和译码器

2.JK触发器J=K=0时,其状态方程为( )

A.Q n+1=Q n B.Q n+1=1

C.Q n+1=Q n D.Q n+1=0

3.由与非门构成的基本RS触发器,要使Q n+1=1,则输入信号应为( )

A.S=R=0 B.S=R=1

C.S=1,R=0 D.S=0,R=1

4.具有记忆功能的逻辑电路是( )

A.加法器 B.减法器

C.寄存器 D.译码器

5.要使JK触发器的状态和当前状态相反,所加激励信号J和K分别是( )

A.0,0 B.0,1

C.1,0 D.1,1

6.T触发器的特征方程为( )

第7题图

7.将D触发器改造成T触发器,如图所示电路中的虚线框内应是( )

A.或非门 B.与非门

C.异或门 D.同或门

8.能够存储0,1二进制信息的器件是( )

A.TTL B.CMOS

C.触发器 D.译码器

9.具有异步置0端和异步置1端的触发器,当触发器处于受CP脉冲控制的情况下正常工作时,这两端所加的信号为( )

10.触发器是一种( )

A.单稳态电路 B.双稳态电路

C.无稳态电路 D.三稳态电路

二、判断题(正确的用“A”表示,错误的用“B”表示)

1.将D触发器的端与D端连接就可构成T′触发器。( )

2.时序逻辑电路中存在反馈,其输出不仅取决于当时的输入,还与电路的上一个状态有关。( )

3.JK触发器只要J,K端同时为1,则一定引起状态翻转。( )

4.JK触发器在CP作用下,若J=K=1,其状态保持不变。( )(www.chuimin.cn)

5.D触发器的特性方程为Q n+1=D,与Q n无关,所以它没有记忆功能。( )

6.同步RS触发器的约束条件RS=0表示不允许出现R=S=1的输入。( )

7.同步触发器存在空翻现象,而边沿触发器和主从触发器克服了空翻。( )

8.所谓上升沿触发,是指触发器的输出状态变化是发生在CP=1期间。( )

9.边沿触发型D触发器的输出状态取决于输入D的状态,与CP是否到来无关。( )

10.当JK触发器的J=K=0,它就转化为T触发器。

11.主从触发器是在CP低电平期间接收信号,是在下降沿时刻触发变化。( )

12.组合逻辑电路是由触发器和门电路构成。( )

13.触发器不具有记忆功能。( )

14.T触发器仅有翻转的逻辑功能。( )

15.同步RS触发器的Q的状态不受CP控制,只与输入的R,S有关。( )

三、填空题

1.D触发器的逻辑功能是_________和_________。

2.同步式触发器的状态会随其输入信号的改变在CP脉冲到来期间发生多次反转,这种现象叫_________。

3.D触发器的信号不受________控制。

4.T触发器可以看成是JK触发器的输入端的________时的应用特例。

5.D触发器要预先设置为1状态,应将端设置为_________电平,设置为_________电平。

6.同步RS触发器的输出不仅受输入信号的影响,还要受________控制。

7.JK触发器的输入信号J=0,K=1,在无CP输入时,触发器处于________,有CP输入后,触发器_________。

8.JK触发器中,初态为0,当J=K=1时,CP到来触发器的状态为_________。

9.触发器是构成时序逻辑电路的基本单元,其与组合逻辑最大的区别是具有________功能,1个触发器能够存储________位二进制信息。

10.用或非门构成的基本RS触发器,当R=0,S=1时,其状态为_________。

11.主从触发器主要由_________、_________、_________构成,它能避免_________现象发生。

12.RS触发器按结构不同可分为无时钟输入端的_________触发器和有时钟输入端的_________。

13.同步RS触发器中,当CP=0,S=0,R=1时,触发器的功能为_________;当CP=1,S=1,R=0时,触发器的功能为_________。

14.T触发器中,若T=1,当CP到来时触发器的功能为________,当CP未到时触发器的功能为________。

15.主从触发器是在_________期间接收信号,是在CP下降沿时刻触发变化。

四、分析计算题

1.如图所示的电路中,已知各触发器初态均为0,试画出6个CP脉冲作用下Q1、Q2和Z端的输出波形图。

第1题图

2.试用D触发器和门电路构成T触发器,画出电路图。

五、综合题

分析如图所示的逻辑电路,设触发器的初始状态均为0,试画出6个CP脉冲下的Q1、Q2、Y的输出波形。

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